AMD强势回击英伟达,宣称256核Zen 6架构‘Venice’CPU在机架级性能上远超Vera 3.3倍
4 小时前 / 阅读约4分钟
来源:Tomshardware
AMD分享了采用Zen 6架构的EPYC‘Venice’CPU的官方基准测试,其旗舰256核模型性能是英伟达Vera的3.3倍。测试基于机架级性能,而非单组件性能,结果为预估值,旨在为AI和企业路线图提供方向性比较。

(图片来源: AMD)

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AMD公布了其即将面世的EPYC‘Venice’CPU的首次官方基准测试结果,这些CPU将成为首批采用Zen 6架构的芯片。尽管旗舰256核型号的详细信息尚未全面披露,但AMD宣称,在固定功率预算为100kW的机架级实现中,其性能高达英伟达Vera CPU的3.3倍。

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(图片来源: Tom's Hardware)

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这项测试的限定条件极大地影响了结果的呈现方式,因此,首先明确这些条件至关重要。AMD是从机架层面来评估性能,而非单个插槽上的单个组件。其结果是基于100kW部署的模拟,反映的是整个机架的性能,而非单个插槽或双插槽系统的性能。

然而,AMD并未对所有这些部署进行实际测试。这涉及大量的模拟工作,AMD在其随结果一同发布的方法论论文中对此进行了详尽阐述。首先,AMD根据处理器的TDP和其他组件来估算功率,并据此计算在100kW功率预算内可部署的节点数量(每个节点为2P系统)。随后,它将节点数量与在少量基准测试中测得的单节点性能相乘。

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这只是规定的开端。AMD并未获得Vera的实物,因此这里的性能仅为预估。AMD采用了其已有的英伟达Grace芯片基准测试结果,并根据Phoronix发布的Vera结果,乘以1.63倍的扩展因子。同时,AMD表示,其256核EPYC Venice的结果是基于与EPYC 9965相比预估的1.7倍扩展因子得出,并参考了“内部测试”数据。

AMD的方法论以这样一句话收尾:“[这些结果]旨在提供方向性比较,而非直接的机架基准测试。”从上述三段规定中不难看出,这句话的分量极重。你无法简单地将单个“节点”(在此情况下为双插槽系统)的性能进行线性扩展。随着规模的扩大,互连以及热和功率限制将成为重要的影响因素。

尽管如此,AMD仍围绕自主智能AI来展示这些结果,尽管其使用的基准测试主要聚焦于通用数据中心任务。主要结果来源于SPEC CPU 2017,特别关注整数吞吐量。此外,AMD还采用了以下基准测试:

  • 基于SPECjbb 2015的服务器端Java性能
  • NGINX Web服务器负载的WRK工具性能
  • 用于内存工作负载的Redis基准测试
  • 使用Memcached进行内存缓存的性能
  • MySQL上的TPROC-C数据库性能

这些“结果”主要是AMD在Phoronix发布了英伟达精心挑选的Vera结果列表后,对英伟达的一次有力回击。AMD正在为下个月的Advancing AI活动奠定基础,届时我们有望听到更多关于Venice、更广泛的Zen 6架构以及AMD企业路线图的详细信息。

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